Загрузка программных средств разработки

СБИС ПЛ подсемейства Stratix V GX


Ресурсы СБИС ПЛ Stratix V GX

  Stratix  V GX (напряжение питания ядра 0.85 В/0.9 В) (1)
5SGXA3 5SGXA4 5SGXA5 5SGXA7 5SGXA9 5SGXAB 5SGXB5 5SGXB6 5SGXB9 5SGXBB
Ресурсы Кол-во адаптивных логических модулей 128 300 158 500 185 000 234 720 317 000 359 200 185 000 225 400 317 000 359 200
Кол-во эквивалентных логических элементов, тысяч 340 420 490 622 840 952 490 597 840 952
Кол-во триггеров 513 200 634 000 740 000 938 880 1 268 000 1 436 800 740 000 901 600 1 268 000 1 436 800
Кол-во блоков встроенного ОЗУ M20K 957 1 900 2 304 2 560 2 640 2 640 2 100 2 660 2 640 2 640
Объем встроенного ОЗУ M20K (Мбит) 19 37 45 50 52 52 41 52 52 52
Объем памяти MLAB (Мбит) 3.92 4.84 5.65 7.16 9.67 10.96 5.65 6.88 9.67 10.96
Кол-во DSP-блоков переменной точности 256 256 256 256 352 352 399 399 352 352
Кол-во умножителей
18 x 18
512 512 512 512 704 704 798 798 704 704
Архитектурные особенности Кол-во глобальных тактовых линий 16
Кол-во региональных тактовых линий 92
Защита проекта от копирования Есть
Поддержка миграции в HardCopy Есть
Подсистема ввода-вывода Поддерживаемые уровни напряжения ввода-вывода (В) 1.2, 1.5, 1.8, 2.5, 3.3 (2)
Поддерживаемые стандарты ввода-вывода LVTTL, LVCMOS, PCI, PCI-X, LVDS, mini-LVDS, RSDS, LVPECL, Differential SSTL-15, Differential SSTL-18, Differential SSTL-2, Differential HSTL-12, Differential HSTL-5, Differential HSTL-18, SSTL-15 (I and II), SSTL-18 (I and II), SSTL-2 (I and II), 1.2-V  HSTL (I and II), 1.5-V  HSTL (I and II), 1.8-V  HSTL (I and II)
Кол-во каналов LVDS (RX/TX) 174 174 210 210 210 210 150 150 150 150
Встроенные цепи динамического выравнивания фаз (DPA) Есть
Встроенные терминирующие резисторы (OCT) Последовательные, параллельные и дифференциальные
Кол-во трансиверов со скоростью передачи
14.1 Гбит/с
36 36 48 48 48 48 66 66 66 66
Кол-во аппаратных контроллеров PCIe (Gen3) 2 2 4 4 4 4 4 4 4 4
Поддерживаемые интерфейсы внешней памяти DDR3, DDR2, QDR II, QDR II+, RLDRAM II, RLDRAM III

(1) Все данные - предварительные.
     назад
(2) Для совместимости с уровнем 3.3 В требуется напряжение питания ввода-вывода 3.0 B.
     назад


Типы корпусов и количество линий ввода-вывода СБИС ПЛ Stratix V

Тип корпуса FBGA (F)
Кол-во выводов 780 1152 1152 1517 1517 1760 1932
Габариты корпуса (мм) 29 х 29 35 х 35 35 х 35 40 х 40 40 х 40 42.5 х 42.5 45 х 45
Расстояние между соседними выводами (мм) 1.0 1.0 1.0 1.0 1.0 1.0 1.0
5SGSD3 360
90
12
(1)
432
108
24
         
5SGSD4 360
90
12
(1)
432
108
24
  696
174
36
     
5SGSD5   552
138
24
  696
174
36
     
5SGSD6       696
174
36
    840
210
48
5SGSD8       696
174
36
    840
210
48
5SGXA3 360
90
12
(1)
432
108
24
432
108
36
696
174
36
     
5SGXA4   552
138
24
432
108
36
696
174
36
     
5SGXA5   552
138
24
432
108
36
696
174
36
600
150
48
  840
210
48
5SGXA7   552
138
24
432
108
36
696
174
36
600
150
48
  840
210
48
5SGXA9       696
174
36
(2)
    840
210
48
5SGXAB       696
174
36
(2)
    840
210
48
5SGXB5       432
108
66
  600
150
66
 
5SGXB6       432
108
66
  600
150
66
 
5SGXB9           600
150
662
 
5SGXBB           600
150
662
 
5SGTC5         600
150
36
(3)
   
5SGTC7         600
150
36
(3)
   
5SEE9       696
174
0
(2)
    840
210
0
5SEEB       696
174
0
(2)
    840
210
0

(1) Тип корпуса Hybrid FBGA (технология сборки flip chip): габариты корпуса 33 x 33 мм, расстояние между соседними выводами 1.0 мм.
     назад
(2)
Тип корпуса Hybrid FBGA (технология сборки flip chip): габариты корпуса 45 x 45 мм, расстояние между соседними выводами 1.0 мм.
     назад
(3) Возможность миграции между микросхемами подсемейств Stratix V GX и Stratix V
GT (неиспользуемые каналы трансиверов подключаются к "земле" или к шине питания).
     назад
Верхнее значение - кол-во пользовательских линий ввода-вывода; среднее значение - кол-во каналов LVDS; нижнее значение - кол-во высокоскоростных трансиверных каналов.
— Возможность вертикальной миграции

© All rights reserved. EFO Ltd. При использовании материалов ссылка на источник обязательна.

Создание сайта
ОлевМедиа, 2012